【CPU】向伺服器領域邁進，ARM宣佈全新高性能系統匯流排方案

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名望的勇者

電梯直達

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發表於 12-10-18 10:08:09 |只看該作者 |降序瀏覽大字中字小字正體化简体化

　　日前ARM公司公佈了CoreLink CCN-504一致性高速快取網路技術以及配套的動態記憶體控製器CoreLink DMC-520，其中前者可以提供最高1Tbit/s的系統頻寬，後者則支援雙通道DDR3/DDR3L/DDR4記憶體。

　　從ARM對這兩個新技術的描繪來看，它們針對的應該是伺服器級產品，其中CoreLink CCN-504技術基於AMBA 4 ACE規範以及四核心Cortex-A15處理器搭載，支援ARMv8指令集和64位運算，可提供128-bit的系統匯流排，頻寬達到了1Tbit/s，甚至支援使用四顆四核心處理器組成網路集群，相當於16個CPU核心。
　　而CoreLink DMC-520則是CoreLink CCN-504的配套動態記憶體控製器，支援雙通道DDR3/DDR3L/DDR4記憶體技術，並支援多種企業級記憶體技術例如ECC x72 DRAM等。同時其也是ARM DDR4介面的組成部分，因此也很可能會用在未來的消費級產品上。
　　目前已經有多家廠商例如LSI以及Calxeda購買CoreLink CCN-504以及CoreLink DMC-520技術，預計在明年即可交付對應的樣品以供合作夥伴研究。從整體意義來說，這不僅是ARM的最新技術成果，還意味着他們距離伺服器領域又再邁進了一大步，在新技術的支援下，伺服器級ARM處理器的運行效率將有很大的提升，再結合他們的功耗優勢，與X86架構產品形成互角將不是“痴人夢話”。

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